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3-D IC制造中PVD集成的挑戰(zhàn)

放大字體??縮小字體 發(fā)布日期:2012-05-10??瀏覽次數(shù):370 ??關注:加關注
核心提示:3-D IC制造中PVD集成的挑戰(zhàn)

摘 要:為實現(xiàn)最有效的銅填充電鍍工藝(electroplating process for copper via fill),需要金屬籽晶(seed metal)的連續(xù)傳導層通過TSV結(jié)構的深度。憑借大多數(shù)TSV設計(深寬比AR〈15:1),物理氣相沉積(PVD)被確立為符合這一要求且風險最低的沉積技術,但對PVD的要求并不像許多人想象的那樣簡單。[第一段]

3-D IC制造中PVD集成的挑戰(zhàn).pdf
 

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